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ADSP-BF522/ADSP-BF523/ADSP-BF524/ADSP-BF525/ADSP-BF526/ADSP-BF527
Table 10. Signal Descriptions (Continued)
Driver
Signal Name
Port J: Multiplexed Peripherals
Type Function
Type 1
PJ0: PPI_FS1/ TMR0
PJ1: PPI_CLK/ TMRCLK
I/O
I
PPI Frame Sync1/ Timer0
PPI Clock/ Timer Clock
C
PJ2: SCL
PJ3: SDA
I/O 5V TWI Serial Clock (This pin is an open-drain output and requires a pull-up
resistor. 4 )
I/O 5V TWI Serial Data (This pin is an open-drain output and requires a pull-up
E
E
resistor. 4 )
Real Time Clock
RTXI
RTXO
JTAG Port
TCK
I
O
I
RTC Crystal Input (This ball should be pulled low when not used.)
RTC Crystal Output (Does not three-state during hibernate.)
JTAG Clock
TDO
TDI
TMS
TRST
EMU
O
I
I
I
O
JTAG Serial Data Out
JTAG Serial Data In
JTAG Mode Select
JTAG Reset (This ball should be pulled low if the JTAG port is not used.)
Emulation Output
C
C
Clock
CLKIN
XTAL
I
O
Clock/Crystal Input
Crystal Output (If CLKBUF is enabled, does not three-state during hibernate.)
CLKBUF
O
Buffered XTAL Output (If enabled, does not three-state during hibernate.)
C
Mode Controls
RESET
NMI
BMODE3–0
ADSP-BF523/ADSP-BF525/ADSP-BF527 Voltage
Regulation I/F
VR SEL
I
I
I
I
Reset
Nonmaskable Interrupt (This ball should be pulled high when not used.)
Boot Mode Strap 3-0
Internal/External Voltage Regulator Select
VR OUT /EXT_WAKE1
O
External FET Drive/Wake up Indication 1 (Does not three-state during
G
hibernate.)
EXT_WAKE0
SS/PG
O
A
Wake up Indication 0 (Does not three-state during hibernate.)
Soft Start/Power Good
C
ADSP-BF522/ADSP-BF524/ADSP-BF526 Voltage
Regulation I/F
EXT_WAKE1
EXT_WAKE0
PG
O
O
A
Wake up Indication 1 (Does not three-state during hibernate.)
Wake up Indication 0 (Does not three-state during hibernate.)
Power Good (This signal should be pulled low when not used.)
Rev. D
|
Page 26 of 88 | July 2013
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